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SV 设计特性

时间:2023-12-10 15:25:30浏览次数:31  
标签:语句 case always SV 特性 sv 设计 unique 赋值

面向可统合设计的主要优化

![](/i/l/?n=23&i=blog/3077491/202312/3077491-20231210

过程语句块特性


  • ABC

过程块语句 always_comb

  • 防止多驱动的问题:赋值块左侧的语句无法被另一个过程块赋值
  • if语句没有写else,sv会提示警告,sv认为是latch
  • always不会再仿真0时刻进行触发

  • 敏感列表 - 只要列表中的变量变化一次,always块中的语句就执行一次
  • always_comb - 一定是组合电路
  • always @* - 不一定表示组合电路

过程块语句:always_latch

过程块语句:always_ff

赋值操作符


64{1'd1};

比较运算符

  • C

inside操作符

  • 判断变量是否在一系列值中

增强case语句


  • unique case保证所有的选项都是唯一的
  • unique case - 并行执行

标签:语句,case,always,SV,特性,sv,设计,unique,赋值
From: https://www.cnblogs.com/Icer-newer/p/17892344.html

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