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无极性RS485芯片设计要点

时间:2023-09-19 18:55:05浏览次数:28  
标签:极性 RS 芯片 RS485 总线 485

极性自适应概述


在 RS-485 通讯网络中,作为主机端(如集中器)的 RS-485 收发器通过两根总线与作为从 机端(如智能电表)的 RS-485 收发器相连接。在传统的 RS-485 系统中,需要对这两根总线的 极性加以区分,系统中所有的 RS-485 收发器总线端口的极性都需要匹配。无极性RS485芯片则内置极性校正电路,上电后能够自动检测系统的总线极性。

无极性RS485芯片

绝大多数无极性RS485芯片与有极性RS485芯片引脚Pin to Pin 兼容。常用的无极性RS485芯片有SSP485N、BL3085N、GM3085N等
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硬件设计注意事项

无极性RS485应用在从机端,需要主机端的配合,为了判别总线极性,必须满足以下条件:

  • 无论主机芯片是否支持无极性功能,主机端都需要通过在 A、B 端口设计合适的上拉和下拉电阻来定义总线极性。

  • 从机端 的 A、B 端口不能设计上拉电阻和下拉电阻,应用电路参考下图

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  • 与普通RS485类似,多个设备间应采用“T”型连接,不应采用星型连接

  • 主机端与“T”型连接末端应有终端匹配电阻(通常采用120Ω电阻)

软件设计注意事项

  • 通信速率应大于25Hz

  • 极性判断时间通常在80ms以内,从机端在极性判别时内必须处于接收态

  • 总线必须在极性判别时间内空闲

  • 连续“0”或“1”的数据串持续时间超过极性判别时间可能会意外触发错误极性校正,必须避免

测试问题

  • 在实际测试中发现如果仅传输一个字节数据会出现数据丢失情况,具体原因仍在排查2023-09-19 18:43:58 星期二

标签:极性,RS,芯片,RS485,总线,485
From: https://www.cnblogs.com/ymchen/p/17715510.html

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