⭐本专栏针对FPGA进行入门学习,从数电中常见的逻辑代数讲起,结合Verilog HDL语言学习与仿真,主要对组合逻辑电路与时序逻辑电路进行分析与设计,对状态机FSM进行剖析与建模。
标签:常量,线网,语法,Verilog,寄存器,HDL,reg,变量 From: https://blog.51cto.com/u_15736437/6024751
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