• 2024-08-03关于SRIO链路复位问题的总结
    1、当SRIO进行初始化时,首先会port-initialized(端口成功初始化)拉高随后link-initialized(链路被成功初始化)拉高。特别注意的是link-initialized表示已接收到七个连续的无差错控制符号,并且已经发送了15个连续符号。如下仿真图所示。2、Link_reset我们应该监视phy_rcvd_link_rese
  • 2024-04-08SRIO学习(1)SRIO介绍以及IP核详解
    文章目录一、SRIO介绍1.1、概要1.2、RapidIO与传统嵌入互连方式的比较1.3、串行RapidIO协议(SRIO)二、RapidIO协议结构及包格式2.1、逻辑层2.2传输层2.3物理层三、IP核详解3.1、逻辑层3.1.1I/O端口3.1.2消息(Message)端口3.1.3用户自定义端口3.1.4维护端口3.1.5Stat
  • 2024-04-08SRIO学习(1)SRIO IP核时钟和复位
    文章目录前言一、时钟1.1、整体说明1.2、典型时钟速率1.3、时钟总结1.4、示例工程二、复位前言通过对时钟和复位的理解可以更好的了解IP核的工作过程,不过不理解也不影响使用,exampledesign帮我们都做好了。一、时钟可以直接看总结1.1、整体说明PHY在两个时钟域
  • 2024-03-21SRIO(Serial RapidIO)PCS层 64B/67B编码介绍(二)
     64b/67b传输码字    PCS使用的64b/67b传输码将64位数据块和/或控制信息编码为67位码字,用于传输,并在接收时反转过程。码字有两种类型:“数据”码字和“控制”码字。数据码字编码64位的数据。控制码字编码64位的控制信息或数据和控制信息的某种组合。码字格式  
  • 2023-05-01SRIO接口卡航电总线解决方案
    TES600是天津拓航科技的一款基于FPGA与DSP协同处理架构的通用高性能实时信号处理平台,该平台采用1片TI的KeyStone系列多核浮点/定点DSPTMS320C6678作为主处理单元,采用1片Xilinx的Kintex-7系列FPGAXC7K325T作为协处理单元,具有1个FMC子卡接口,具有4路SFP+万兆光纤接口,处理节点之间通
  • 2023-02-03ZYNQ与DSP之间SRIO通信例程,实操分享
    XQ6657Z35/45-EVM高速数据处理评估板(XQTyer评估板)由广州星嵌电子科技有限公司自主研发,核心板包含一片TIDSPTMS320C6657和一片XilinxZYNQ-7000SoC处理器XC7Z035-2FFG67
  • 2023-02-02ZYNQ(FPGA)与DSP之间SRIO通信实现
    1 ZYNQ与DSP之间通信例程1.1 ZYNQ与DSP之间SRIO通信1.1.1 例程位置ZYNQ例程保存在资料盘中的Demo\ZYNQ\PL\srio_gen2_0_ex文件夹下。DSP例程保存在资料盘中的Demo\D