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第13篇:4线-2线优先编码器

时间:2024-03-25 16:02:47浏览次数:26  
标签:编码 13 编码器 输出 优先 级别 输入

Q:上一篇我们实现的4线-2线普通编码器在实际应用中会存在一个问题:如果I_3I_2I_1I_0中有2个或2个以上的取值同时为1,输出编码会出现混乱。本篇我们再来学习设计4线-2线优先编码器解决这个问题。

A:基本原理:规定I_3I_2I_1I_0操作先后顺序,即优先级别。4个输入的优先级别的高低次序依次为I_3I_2I_1I_0。优先编码器允许2个以上的输入同时为1,但只对优先级别高的输入进行编码 。4线-2线优先编码器的真值表:

image-20230915110257395

用Verilog过程结构always表示部分代码:

image-20230915110550098

同样使用DE2-115开发板的SW[3:0]作为输入I(I_3I_2I_1I_0),LEDR[1:0]显示Y(Y_1Y_0)的输出值,在顶层.v文件中例化4线-2线优先编码器。

image-20230919161744521

标签:编码,13,编码器,输出,优先,级别,输入
From: https://blog.csdn.net/weixin_47841246/article/details/137011592

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