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SV概述

时间:2023-12-09 19:56:58浏览次数:29  
标签:验证 System SV 概述 Verilog 偏向

System Verilog概述

路科验证视频,B站可看(补充一下知识)
学习SV之前,最好有Verilog基础

SV诞生

SV发展历史

  • Verilog - 偏向于设计
  • System Verilog - 偏向于验证

SV的语言继承历史

标签:验证,System,SV,概述,Verilog,偏向
From: https://www.cnblogs.com/Icer-newer/p/17884281.html

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